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数字电子技术基础(二十四)——TTL门电路的高、低电平的输出特性曲线

目录

1 TTL门电路的特性曲线

1.1 高电平输出特性

1.1.2 高电平输出特性的实验过程

1.1.2 TTL门电路的输出特性的实验结果

1.2  低电平的输出特性


1 TTL门电路的特性曲线

1.1 高电平输出特性

1.1.2 高电平输出特性的实验过程

现在想要测试TTL门电路的输出特性,以TTL与非门为例子。如下图所示为TTL与非门的测试电路:

图1 对于与非门高电平输出特性的实验

将与非门的其中一端接地(在上图中为B端接地),另一端接高电平(在上图中为A端接高电平),此时的与非门中的晶体管T_2T_4截止,推拉式输出级的晶体管T_3、二极管D_1全部流向负载,示意图如下所示:

图2 实验中部门与非门电路图

T_3输出的集电极电流,经由导通的二极管D_1全部流向了负载。在高电平输出时的负载电流被定义为拉电流。通过改变负载的阻值可以改变拉电流值的大小,在测试电路当中,通过改变负载的阻值可以得到如下所示的公式:I_{OH}=\frac{V_{OH}}{R_U}

1.1.2 TTL门电路的输出特性的实验结果

当电路输出为高电平的时候,T_3工作于射级跟随的状态,输出的高电平等于集电极电位U_{C2}减去二极管D_1的正向导通电压,输出的高电平会非常稳定,计算公式如下所示:

                                                               V_{OH}=V_{C2}-V_{BE3}-V_{D1}

通过对于TTL门电路进行检测,可以得到如下图所示的电路曲线:

图3 TTL高电平的输出特性曲线

当拉电流比较小的时候,高电平输出的信号受到拉电流的影响也比较小,输出的电压比较稳定,而随着拉电流的增加,T_3由放大区进入到饱和区,失去了射级跟随的能力,T_3的变化如下图红线所示:

图4 T3由放大区到饱和区的变化过程

此时饱和区的晶体管输出的电位为:

                                                  V_{OH}=V_{CC}-I_{OH}R_4-V_{CES3}-V_{D1}

在上面的公式中,V_{CES3}表示的是三极管T_3饱和时集电极和发射级之间的电位差(输出饱和电压)。此时晶体管的电位V_O等于直流电压源V_{CC}减去拉电流在R_4上的压降,减去T_3的输出饱和压降,减去二极管D_1的导通压降,电路的输出电压随着拉电流的增加而迅速地下降,当下降到高电平地输出下限值的时候,所对应的拉电流为拉电流的最大值。如果负载电流超过电流的最大值,那么门电路的输出电压将会进入不高不低的范围,这种输出电压连接到输入端的时候,那么就会造成下一级的混乱。

1.2  低电平的输出特性

将与非门2个输入端全部接高电平,对于与非来说,输入端均为高电平的情况下,此时测试电路如下图所示:

图5 与非情况下输入均为高电平的测试电路

 如下所示与非门的晶体管示意图:

图6 实验中部门与非门电路图

T_2T_4饱和导通,此时T_3D_1截止,输出是T_4的饱和输出压降,为低电平信号,此时的负载电流是倒灌回门电路的输出端的,流入T_4的集电极,门电路低电平输出时,负载电流定义为灌电流,调节这个变阻器R_L的阻值,就可以调节灌电流值的大小。

电流流向如下所示:

图7 低电平与非门的部门电路结构以及电流流向

通过测试电路,可以得出低电平输出时输出端的伏安特性曲线如下所示:

图8 低电平输出时输出端的伏安特定曲线

由上面的曲线中显示得,当门电路输出为低电平时,T_4饱和导通,但是T_4的集电极C和发射级E之间,饱和导通的T_4两者之间的内阻非常小,随着灌电流的增加,输出的低电位也随着增加了。输入低电平电压的公式如下所示:

                                                                U_{OL}=I_{OL}R_{O5}+U_{CES5}

当低电平输出随着灌电流的增加而上升至低电平输出的上限值的时候,所对应的负载电流为灌电流的最大值,也就是说,负载电流不能超过这个值,否则门电路的输出也是一个不高不低的电压信号,同样会引起下一级门电路的逻辑功能的混乱。

图9 低电平输出超过上限值的输出端伏安特定曲线

在上图中,T_4饱和导通,输出电阻R_{O5}很小,随着I_{OL}的增加,在R_{O5}上的压降增加。

74系列的TTL门电路输出的上限值大于在0.4V左右,而灌电路的最小值约为16mA。

(本文参考了哈尔滨工业大学的《数字电子技术基础》内容)

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